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lygwmj
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发站内信
发表于:2009/6/20 2:28:35
#0楼
时钟周期为T,触发器D1的建立时间最大为T1max,最小为T1min。组合逻辑电路最大延迟为T2max,最小为T2min。问,触发器D2的建立时间T3和保持时间应满足什么条件?
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知道一点
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工控人谈电商
2013国庆活动
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发表于:2009/6/20 10:29:21
#1楼
PLC? minT
快乐 幸福 自由 比什么都重要
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发站内信
发表于:2009/6/21 15:49:37
#2楼
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